Submit Search
Upload
Verilog-HDL Tutorial (11)
•
0 likes
•
2,455 views
Hiroki Nakahara
Follow
Verilog-HDL Tutorial Using DE0 FPGA Board
Read less
Read more
Education
Report
Share
Report
Share
1 of 14
Download now
Download to read offline
Recommended
C++ マルチスレッドプログラミング
C++ マルチスレッドプログラミング
Kohsuke Yuasa
シェル芸初心者によるシェル芸入門
シェル芸初心者によるシェル芸入門
icchy
Intel AVX-512/富岳SVE用SIMDコード生成ライブラリsimdgen
Intel AVX-512/富岳SVE用SIMDコード生成ライブラリsimdgen
MITSUNARI Shigeo
C#とILとネイティブと
C#とILとネイティブと
信之 岩永
組み込み関数(intrinsic)によるSIMD入門
組み込み関数(intrinsic)によるSIMD入門
Norishige Fukushima
いまさら聞けないarmを使ったNEONの基礎と活用事例
いまさら聞けないarmを使ったNEONの基礎と活用事例
Fixstars Corporation
カスタムメモリマネージャと高速なメモリアロケータについて
カスタムメモリマネージャと高速なメモリアロケータについて
alwei
中3女子でもわかる constexpr
中3女子でもわかる constexpr
Genya Murakami
Recommended
C++ マルチスレッドプログラミング
C++ マルチスレッドプログラミング
Kohsuke Yuasa
シェル芸初心者によるシェル芸入門
シェル芸初心者によるシェル芸入門
icchy
Intel AVX-512/富岳SVE用SIMDコード生成ライブラリsimdgen
Intel AVX-512/富岳SVE用SIMDコード生成ライブラリsimdgen
MITSUNARI Shigeo
C#とILとネイティブと
C#とILとネイティブと
信之 岩永
組み込み関数(intrinsic)によるSIMD入門
組み込み関数(intrinsic)によるSIMD入門
Norishige Fukushima
いまさら聞けないarmを使ったNEONの基礎と活用事例
いまさら聞けないarmを使ったNEONの基礎と活用事例
Fixstars Corporation
カスタムメモリマネージャと高速なメモリアロケータについて
カスタムメモリマネージャと高速なメモリアロケータについて
alwei
中3女子でもわかる constexpr
中3女子でもわかる constexpr
Genya Murakami
Constexpr 中3女子テクニック
Constexpr 中3女子テクニック
Genya Murakami
関数プログラミング入門
関数プログラミング入門
Hideyuki Tanaka
目grep入門 +解説
目grep入門 +解説
murachue
Verilator勉強会 2021/05/29
Verilator勉強会 2021/05/29
ryuz88
ゼロから始める自作 CPU 入門
ゼロから始める自作 CPU 入門
Hirotaka Kawata
ゲーム開発とデザインパターン
ゲーム開発とデザインパターン
Takashi Komada
Intro to SVE 富岳のA64FXを触ってみた
Intro to SVE 富岳のA64FXを触ってみた
MITSUNARI Shigeo
C++の黒魔術
C++の黒魔術
Daichi OBINATA
レガシーコード改善のススメ
レガシーコード改善のススメ
Akira Hirasawa
shared_ptrとゲームプログラミングでのメモリ管理
shared_ptrとゲームプログラミングでのメモリ管理
DADA246
新しい並列for構文のご提案
新しい並列for構文のご提案
yohhoy
SDL2の紹介
SDL2の紹介
nyaocat
UnicodeによるXSSとSQLインジェクションの可能性
UnicodeによるXSSとSQLインジェクションの可能性
Hiroshi Tokumaru
中3女子が狂える本当に気持ちのいい constexpr
中3女子が狂える本当に気持ちのいい constexpr
Genya Murakami
プログラムを高速化する話
プログラムを高速化する話
京大 マイコンクラブ
CUDAプログラミング入門
CUDAプログラミング入門
NVIDIA Japan
給自己更好未來的 3 個練習:嵌入式作業系統設計、實做,與移植 (2015 年春季 ) 課程說明
給自己更好未來的 3 個練習:嵌入式作業系統設計、實做,與移植 (2015 年春季 ) 課程說明
National Cheng Kung University
左と右の話
左と右の話
Cryolite
ドメイン駆動設計という仕事の流儀
ドメイン駆動設計という仕事の流儀
増田 亨
Map
Map
kikairoya
Verilog-HDL Tutorial (15) hardware
Verilog-HDL Tutorial (15) hardware
Hiroki Nakahara
Naist2015 dec ver1
Naist2015 dec ver1
Hiroki Nakahara
More Related Content
What's hot
Constexpr 中3女子テクニック
Constexpr 中3女子テクニック
Genya Murakami
関数プログラミング入門
関数プログラミング入門
Hideyuki Tanaka
目grep入門 +解説
目grep入門 +解説
murachue
Verilator勉強会 2021/05/29
Verilator勉強会 2021/05/29
ryuz88
ゼロから始める自作 CPU 入門
ゼロから始める自作 CPU 入門
Hirotaka Kawata
ゲーム開発とデザインパターン
ゲーム開発とデザインパターン
Takashi Komada
Intro to SVE 富岳のA64FXを触ってみた
Intro to SVE 富岳のA64FXを触ってみた
MITSUNARI Shigeo
C++の黒魔術
C++の黒魔術
Daichi OBINATA
レガシーコード改善のススメ
レガシーコード改善のススメ
Akira Hirasawa
shared_ptrとゲームプログラミングでのメモリ管理
shared_ptrとゲームプログラミングでのメモリ管理
DADA246
新しい並列for構文のご提案
新しい並列for構文のご提案
yohhoy
SDL2の紹介
SDL2の紹介
nyaocat
UnicodeによるXSSとSQLインジェクションの可能性
UnicodeによるXSSとSQLインジェクションの可能性
Hiroshi Tokumaru
中3女子が狂える本当に気持ちのいい constexpr
中3女子が狂える本当に気持ちのいい constexpr
Genya Murakami
プログラムを高速化する話
プログラムを高速化する話
京大 マイコンクラブ
CUDAプログラミング入門
CUDAプログラミング入門
NVIDIA Japan
給自己更好未來的 3 個練習:嵌入式作業系統設計、實做,與移植 (2015 年春季 ) 課程說明
給自己更好未來的 3 個練習:嵌入式作業系統設計、實做,與移植 (2015 年春季 ) 課程說明
National Cheng Kung University
左と右の話
左と右の話
Cryolite
ドメイン駆動設計という仕事の流儀
ドメイン駆動設計という仕事の流儀
増田 亨
Map
Map
kikairoya
What's hot
(20)
Constexpr 中3女子テクニック
Constexpr 中3女子テクニック
関数プログラミング入門
関数プログラミング入門
目grep入門 +解説
目grep入門 +解説
Verilator勉強会 2021/05/29
Verilator勉強会 2021/05/29
ゼロから始める自作 CPU 入門
ゼロから始める自作 CPU 入門
ゲーム開発とデザインパターン
ゲーム開発とデザインパターン
Intro to SVE 富岳のA64FXを触ってみた
Intro to SVE 富岳のA64FXを触ってみた
C++の黒魔術
C++の黒魔術
レガシーコード改善のススメ
レガシーコード改善のススメ
shared_ptrとゲームプログラミングでのメモリ管理
shared_ptrとゲームプログラミングでのメモリ管理
新しい並列for構文のご提案
新しい並列for構文のご提案
SDL2の紹介
SDL2の紹介
UnicodeによるXSSとSQLインジェクションの可能性
UnicodeによるXSSとSQLインジェクションの可能性
中3女子が狂える本当に気持ちのいい constexpr
中3女子が狂える本当に気持ちのいい constexpr
プログラムを高速化する話
プログラムを高速化する話
CUDAプログラミング入門
CUDAプログラミング入門
給自己更好未來的 3 個練習:嵌入式作業系統設計、實做,與移植 (2015 年春季 ) 課程說明
給自己更好未來的 3 個練習:嵌入式作業系統設計、實做,與移植 (2015 年春季 ) 課程說明
左と右の話
左と右の話
ドメイン駆動設計という仕事の流儀
ドメイン駆動設計という仕事の流儀
Map
Map
Viewers also liked
Verilog-HDL Tutorial (15) hardware
Verilog-HDL Tutorial (15) hardware
Hiroki Nakahara
Naist2015 dec ver1
Naist2015 dec ver1
Hiroki Nakahara
FPGAX2016 ドキュンなFPGA
FPGAX2016 ドキュンなFPGA
Hiroki Nakahara
Verilog-HDL Tutorial (14)
Verilog-HDL Tutorial (14)
Hiroki Nakahara
Verilog-HDL Tutorial (12)
Verilog-HDL Tutorial (12)
Hiroki Nakahara
Verilog-HDL Tutorial (15) software
Verilog-HDL Tutorial (15) software
Hiroki Nakahara
Verilog-HDL Tutorial (13)
Verilog-HDL Tutorial (13)
Hiroki Nakahara
Nested RNSを用いたディープニューラルネットワークのFPGA実装
Nested RNSを用いたディープニューラルネットワークのFPGA実装
Hiroki Nakahara
Verilog-HDL Tutorial (9)
Verilog-HDL Tutorial (9)
Hiroki Nakahara
FPL15 talk: Deep Convolutional Neural Network on FPGA
FPL15 talk: Deep Convolutional Neural Network on FPGA
Hiroki Nakahara
私のファミコンのfpsは530000です。もちろんフルパワーで(以下略
私のファミコンのfpsは530000です。もちろんフルパワーで(以下略
Hiroki Nakahara
電波望遠鏡用の分光器をAltera SDK for OpenCL使ってサクッと作ってみた
電波望遠鏡用の分光器をAltera SDK for OpenCL使ってサクッと作ってみた
Hiroki Nakahara
Altera sdk for open cl アンケート集計結果(公開版)
Altera sdk for open cl アンケート集計結果(公開版)
Hiroki Nakahara
A Random Forest using a Multi-valued Decision Diagram on an FPGa
A Random Forest using a Multi-valued Decision Diagram on an FPGa
Hiroki Nakahara
Tensor flow usergroup 2016 (公開版)
Tensor flow usergroup 2016 (公開版)
Hiroki Nakahara
(公開版)FPGAエクストリームコンピューティング2017
(公開版)FPGAエクストリームコンピューティング2017
Hiroki Nakahara
(公開版)Reconf研2017GUINNESS
(公開版)Reconf研2017GUINNESS
Hiroki Nakahara
2値ディープニューラルネットワークと組込み機器への応用: 開発中のツール紹介
2値ディープニューラルネットワークと組込み機器への応用: 開発中のツール紹介
Hiroki Nakahara
2値化CNN on FPGAでGPUとガチンコバトル(公開版)
2値化CNN on FPGAでGPUとガチンコバトル(公開版)
Hiroki Nakahara
Viewers also liked
(19)
Verilog-HDL Tutorial (15) hardware
Verilog-HDL Tutorial (15) hardware
Naist2015 dec ver1
Naist2015 dec ver1
FPGAX2016 ドキュンなFPGA
FPGAX2016 ドキュンなFPGA
Verilog-HDL Tutorial (14)
Verilog-HDL Tutorial (14)
Verilog-HDL Tutorial (12)
Verilog-HDL Tutorial (12)
Verilog-HDL Tutorial (15) software
Verilog-HDL Tutorial (15) software
Verilog-HDL Tutorial (13)
Verilog-HDL Tutorial (13)
Nested RNSを用いたディープニューラルネットワークのFPGA実装
Nested RNSを用いたディープニューラルネットワークのFPGA実装
Verilog-HDL Tutorial (9)
Verilog-HDL Tutorial (9)
FPL15 talk: Deep Convolutional Neural Network on FPGA
FPL15 talk: Deep Convolutional Neural Network on FPGA
私のファミコンのfpsは530000です。もちろんフルパワーで(以下略
私のファミコンのfpsは530000です。もちろんフルパワーで(以下略
電波望遠鏡用の分光器をAltera SDK for OpenCL使ってサクッと作ってみた
電波望遠鏡用の分光器をAltera SDK for OpenCL使ってサクッと作ってみた
Altera sdk for open cl アンケート集計結果(公開版)
Altera sdk for open cl アンケート集計結果(公開版)
A Random Forest using a Multi-valued Decision Diagram on an FPGa
A Random Forest using a Multi-valued Decision Diagram on an FPGa
Tensor flow usergroup 2016 (公開版)
Tensor flow usergroup 2016 (公開版)
(公開版)FPGAエクストリームコンピューティング2017
(公開版)FPGAエクストリームコンピューティング2017
(公開版)Reconf研2017GUINNESS
(公開版)Reconf研2017GUINNESS
2値ディープニューラルネットワークと組込み機器への応用: 開発中のツール紹介
2値ディープニューラルネットワークと組込み機器への応用: 開発中のツール紹介
2値化CNN on FPGAでGPUとガチンコバトル(公開版)
2値化CNN on FPGAでGPUとガチンコバトル(公開版)
More from Hiroki Nakahara
FCCM2020: High-Throughput Convolutional Neural Network on an FPGA by Customiz...
FCCM2020: High-Throughput Convolutional Neural Network on an FPGA by Customiz...
Hiroki Nakahara
ROS User Group Meeting #28 マルチ深層学習とROS
ROS User Group Meeting #28 マルチ深層学習とROS
Hiroki Nakahara
FPGAX2019
FPGAX2019
Hiroki Nakahara
SBRA2018講演資料
SBRA2018講演資料
Hiroki Nakahara
DSF2018講演スライド
DSF2018講演スライド
Hiroki Nakahara
ISCAS'18: A Deep Neural Network on the Nested RNS (NRNS) on an FPGA: Applied ...
ISCAS'18: A Deep Neural Network on the Nested RNS (NRNS) on an FPGA: Applied ...
Hiroki Nakahara
ISMVL2018: A Ternary Weight Binary Input Convolutional Neural Network
ISMVL2018: A Ternary Weight Binary Input Convolutional Neural Network
Hiroki Nakahara
FPGA2018: A Lightweight YOLOv2: A binarized CNN with a parallel support vecto...
FPGA2018: A Lightweight YOLOv2: A binarized CNN with a parallel support vecto...
Hiroki Nakahara
FPT17: An object detector based on multiscale sliding window search using a f...
FPT17: An object detector based on multiscale sliding window search using a f...
Hiroki Nakahara
Verilog-HDL Tutorial (8)
Verilog-HDL Tutorial (8)
Hiroki Nakahara
Verilog-HDL Tutorial (7)
Verilog-HDL Tutorial (7)
Hiroki Nakahara
More from Hiroki Nakahara
(11)
FCCM2020: High-Throughput Convolutional Neural Network on an FPGA by Customiz...
FCCM2020: High-Throughput Convolutional Neural Network on an FPGA by Customiz...
ROS User Group Meeting #28 マルチ深層学習とROS
ROS User Group Meeting #28 マルチ深層学習とROS
FPGAX2019
FPGAX2019
SBRA2018講演資料
SBRA2018講演資料
DSF2018講演スライド
DSF2018講演スライド
ISCAS'18: A Deep Neural Network on the Nested RNS (NRNS) on an FPGA: Applied ...
ISCAS'18: A Deep Neural Network on the Nested RNS (NRNS) on an FPGA: Applied ...
ISMVL2018: A Ternary Weight Binary Input Convolutional Neural Network
ISMVL2018: A Ternary Weight Binary Input Convolutional Neural Network
FPGA2018: A Lightweight YOLOv2: A binarized CNN with a parallel support vecto...
FPGA2018: A Lightweight YOLOv2: A binarized CNN with a parallel support vecto...
FPT17: An object detector based on multiscale sliding window search using a f...
FPT17: An object detector based on multiscale sliding window search using a f...
Verilog-HDL Tutorial (8)
Verilog-HDL Tutorial (8)
Verilog-HDL Tutorial (7)
Verilog-HDL Tutorial (7)
Recently uploaded
Divorce agreements in administrative work.pdf
Divorce agreements in administrative work.pdf
oganekyokoi
Establishment and operation of medical corporations.pdf
Establishment and operation of medical corporations.pdf
oganekyokoi
リアル戦国探究in米沢 当日講座2スライド(スタッフ共有用)『人を致すも人に致されず』についてのスライド
リアル戦国探究in米沢 当日講座2スライド(スタッフ共有用)『人を致すも人に致されず』についてのスライド
Ken Fukui
リアル戦国探究in米沢 事前講座1スライド(スタッフ共有用)『川中島の謎』についてのスライド
リアル戦国探究in米沢 事前講座1スライド(スタッフ共有用)『川中島の謎』についてのスライド
Ken Fukui
リアル戦国探究in米沢 当日講座1(スタッフ共有用)『兵は詐をもって立つ』についてのスライド
リアル戦国探究in米沢 当日講座1(スタッフ共有用)『兵は詐をもって立つ』についてのスライド
Ken Fukui
My Inspire High Award 2024「他者と自分、対立を防ぐには?」
My Inspire High Award 2024「他者と自分、対立を防ぐには?」
inspirehighstaff03
TEAMIN Service overview for customer_20240422.pdf
TEAMIN Service overview for customer_20240422.pdf
yukisuga3
International Politics I - Lecture 1
International Politics I - Lecture 1
Toru Oga
My Inspire High Award 2024「Yakushima Islandってなんか変じゃない?」.pdf
My Inspire High Award 2024「Yakushima Islandってなんか変じゃない?」.pdf
inspirehighstaff03
My Inspire High Award2024「外国人が日本のテーブルマナーに驚く理由は?」
My Inspire High Award2024「外国人が日本のテーブルマナーに驚く理由は?」
inspirehighstaff03
My Inspire High Award 2024「世の中の流行はどのようにして生まれるのか」
My Inspire High Award 2024「世の中の流行はどのようにして生まれるのか」
inspirehighstaff03
リアル戦国探究in米沢 当日講座3スライド(スタッフ共有用)『糧は三度はさいせず』についてのスライド
リアル戦国探究in米沢 当日講座3スライド(スタッフ共有用)『糧は三度はさいせず』についてのスライド
Ken Fukui
My Inspire High Award 2024「老いることは不幸なこと?」
My Inspire High Award 2024「老いることは不幸なこと?」
inspirehighstaff03
My Inspire High Award 2024 「孤独は敵なのか?」
My Inspire High Award 2024 「孤独は敵なのか?」
inspirehighstaff03
What I did before opening my business..pdf
What I did before opening my business..pdf
oganekyokoi
My Inspire High Award 2024「なぜ人は他人と違うところがあってもそれをなかなか誇れないのか?」
My Inspire High Award 2024「なぜ人は他人と違うところがあってもそれをなかなか誇れないのか?」
inspirehighstaff03
My Inspire High Award 2024「スーパーマーケットで回収されたキャベツ外葉は廃棄されているの?」
My Inspire High Award 2024「スーパーマーケットで回収されたキャベツ外葉は廃棄されているの?」
inspirehighstaff03
My Inspire High Award 2024 「AIと仲良くなるには?」
My Inspire High Award 2024 「AIと仲良くなるには?」
inspirehighstaff03
My Inspire High Award 2024 「本当の『悪者』って何?」
My Inspire High Award 2024 「本当の『悪者』って何?」
inspirehighstaff03
【ゲーム理論入門】ChatGPTが作成した ゲーム理論の問題を解く #3 Slide
【ゲーム理論入門】ChatGPTが作成した ゲーム理論の問題を解く #3 Slide
ssusere0a682
Recently uploaded
(20)
Divorce agreements in administrative work.pdf
Divorce agreements in administrative work.pdf
Establishment and operation of medical corporations.pdf
Establishment and operation of medical corporations.pdf
リアル戦国探究in米沢 当日講座2スライド(スタッフ共有用)『人を致すも人に致されず』についてのスライド
リアル戦国探究in米沢 当日講座2スライド(スタッフ共有用)『人を致すも人に致されず』についてのスライド
リアル戦国探究in米沢 事前講座1スライド(スタッフ共有用)『川中島の謎』についてのスライド
リアル戦国探究in米沢 事前講座1スライド(スタッフ共有用)『川中島の謎』についてのスライド
リアル戦国探究in米沢 当日講座1(スタッフ共有用)『兵は詐をもって立つ』についてのスライド
リアル戦国探究in米沢 当日講座1(スタッフ共有用)『兵は詐をもって立つ』についてのスライド
My Inspire High Award 2024「他者と自分、対立を防ぐには?」
My Inspire High Award 2024「他者と自分、対立を防ぐには?」
TEAMIN Service overview for customer_20240422.pdf
TEAMIN Service overview for customer_20240422.pdf
International Politics I - Lecture 1
International Politics I - Lecture 1
My Inspire High Award 2024「Yakushima Islandってなんか変じゃない?」.pdf
My Inspire High Award 2024「Yakushima Islandってなんか変じゃない?」.pdf
My Inspire High Award2024「外国人が日本のテーブルマナーに驚く理由は?」
My Inspire High Award2024「外国人が日本のテーブルマナーに驚く理由は?」
My Inspire High Award 2024「世の中の流行はどのようにして生まれるのか」
My Inspire High Award 2024「世の中の流行はどのようにして生まれるのか」
リアル戦国探究in米沢 当日講座3スライド(スタッフ共有用)『糧は三度はさいせず』についてのスライド
リアル戦国探究in米沢 当日講座3スライド(スタッフ共有用)『糧は三度はさいせず』についてのスライド
My Inspire High Award 2024「老いることは不幸なこと?」
My Inspire High Award 2024「老いることは不幸なこと?」
My Inspire High Award 2024 「孤独は敵なのか?」
My Inspire High Award 2024 「孤独は敵なのか?」
What I did before opening my business..pdf
What I did before opening my business..pdf
My Inspire High Award 2024「なぜ人は他人と違うところがあってもそれをなかなか誇れないのか?」
My Inspire High Award 2024「なぜ人は他人と違うところがあってもそれをなかなか誇れないのか?」
My Inspire High Award 2024「スーパーマーケットで回収されたキャベツ外葉は廃棄されているの?」
My Inspire High Award 2024「スーパーマーケットで回収されたキャベツ外葉は廃棄されているの?」
My Inspire High Award 2024 「AIと仲良くなるには?」
My Inspire High Award 2024 「AIと仲良くなるには?」
My Inspire High Award 2024 「本当の『悪者』って何?」
My Inspire High Award 2024 「本当の『悪者』って何?」
【ゲーム理論入門】ChatGPTが作成した ゲーム理論の問題を解く #3 Slide
【ゲーム理論入門】ChatGPTが作成した ゲーム理論の問題を解く #3 Slide
Verilog-HDL Tutorial (11)
1.
1 Verilog-HDL 講習会DE0編(11) PS2キーボードの制御 4, July,
2013 鹿児島大学 中原 啓貴
2.
PS/2 の規格 • 信号:「クロック」「データ」の2本 ‒
デバイス側から送信される • データはクロックの立ち下がりで有効 • データ(11ビット) ‒ スタートビット(1ビットの「0」) ‒ データ(8ビット、LSBから送信) ‒ パリティ(データの1の個数が奇数1、偶数0) ‒ ストップビット(1ビットの「1」) • キーボードに関して ‒ キーを押す:キーコード(8ビットのデータ) ‒ キーを離す:「F0」を送信して、キーコードを送る • 注意:5V動作のキーボードもあり (DE0では3.3Vキーボードのみ動作?) 2
3.
PS/2キーボードの タイミングチャート 3 CLOCK DATA スタートビット (必ず0) Bit0 Bit1 Bit2 Bit3 Bit4 Bit5 Bit6 Bit7 パリティビット ストップビット (必ず1) 0 0 1
0 1 1 1 1 0 0 1 データビット (8ビット) 最下位ビット (LSB)から送信 (この例では0111_1010を送信) データビットの1の個数が 偶数のとき→1, 奇数のとき→0 CLOCKの立ち下がりでDATA有効 Tck=30us∼50usつまり,10.0Hz∼16.6Hz
4.
データ受信方法 • まず, CLOCKの立ち下がりを検出 •
1usec間隔で連続した「111000」を受信 ‒ 1usecは適当に決めた間隔. 速過ぎてもだめだけど… 4 CLOCK DATA PS2_KBCLK 受信回路の CLOCK 1usec → 1MHz 1 1 1 0 0 0 シフトレジスタを使う! catch_negedge[5:0] <= {catch_negedge[4:0], PS2_KBCLK}
5.
PS2キーボード受信回路 5 CLOCK_50 RESET_N CLK1MHz CLK1MHz PS2_KBCLK PS2_KBDAT LEDG RESET_N 10 1MHz生成回路 (Gen_CLK1MHz) PS2キーボード 受信回路 (DE0_TOP)
6.
状態遷移図 6 Start Bit Data Bit0 Data Bit1
Data Bit2 Data Bit3Stop Bit Parity Bit Data Bit7 Data Bit6 Data Bit5 Data Bit4 Reset LEDG <= 0; receive_data<= 0; catch_negedge <= 0; catch_negedge==6'b111000 receive_data[0] <= PS2_KBDAT; catch_negedge==6'b111000 receive_data[1] <= PS2_KBDAT; catch_negedge==6'b111000 receive_data[2] <= PS2_KBDAT; catch_negedge==6'b111000 receive_data[3] <= PS2_KBDAT; catch_negedge==6'b111000 receive_data[4] <= PS2_KBDAT; catch_negedge==6'b111000 receive_data[5] <= PS2_KBDAT; catch_negedge==6'b111000 receive_data[6] <= PS2_KBDAT; catch_negedge==6'b111000 receive_data[7] <= PS2_KBDAT; catch_negedge==6'b111000 receive_data[8] <= PS2_KBDAT; catch_negedge==6'b111000 receive_data[9] <= PS2_KBDAT; catch_negedge==6'b111000 LEDG <= receive_data; この状態ではストップビットを 読み込まないように設計した (LEDGに今まで受信したデータを表示)
7.
7 • ピン配置が面倒くさいので、デフォルト のプロジェクトを読み込みましょう! (DE0に限った事ではないが、Terasic製品はサンプルCD-ROMの プロジェクトを改変するのが楽でお勧め) DE0付属のCD-ROM Demonstrations 内の "DE0_Top"フォルダの ファイル全てを C:¥verilog¥DE0_tutorial_7_1¥ 内にコピー
8.
DE0_TOP.qpfをダブルクリック してQuartus IIを起動 8 Pin Plannerを開いてみると ピン配置が終わっている!
9.
Verilog-HDLを入力 9 ダブルクリック Verilog-HDLの テンプレートが 表示されるので コードを入力 コード入力したら保存を忘れずに!
10.
入力するVerilog-HDL 10
11.
11 入力する Verilog-HDL (続き)
12.
動作させてみよう • キーボードを入力するとLEDGにデータが表示される (今回はJIS配列日本語PS2キーボードを使用) 12 キーボードの 「k」を押した 受信したデータ 0 1
0 0 0 0 1 0 データの1の個数は2, つまり偶数なのでパリティ=1 ストップ ビット=0
13.
13 受信したデータ 0 1 0
0 0 0 1 0 つまり、16進数では 0x42なので 「k」のスキャンコードと一致 キーボードを離す時は 「F0」+「スキャンコード」が送信される (離したときに一瞬上位ビットのLEDGが 点滅するのはそのため) 機能キーは特にキーボード毎 (英語キーボードや101キーボード等)に スキャンコードが異なるので注意!
14.
課題 • PS/2キーボードのスキャンコードを7セグ メントLEDに表示するように改造せよ • PS/2キーボード受信回路のVerilog-HDLの シミュレーションを行い,
検証を行え ‒ 周期を確認し, 仕様と一致するか確認 14
Download now