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ADC ATMEGA32
   Informationen aus:
  Datenblatt ATMEGA32
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Wägeverfahren




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Eigenschaften
                                  Datenblatt ATMEGA32



• 10-bit Resolution
• Successive approximation ADC
• ±2 LSB Absolute Accuracy
• 13 μs - 260 μs Conversion Time
• Up to 15 kSPS at Maximum Resolution
• 8 Multiplexed Single Ended Input Channels
• 2 Differential Input Channels with Optional Gain of 10x and 200x
• 0 - VCC ADC Input Voltage Range
• Free Running or Single Conversion Mode
• ADC Start Conversion by Auto Triggering on Interrupt Sources
• Interrupt on ADC Conversion Complete

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                                  0   1         0




                                      ADLAR             ADCH             ADCL
                                          0         x x x x x x 9 8 7 6 5 4 3 2 1 0
                                          1         9 8 7 6 5 4 3 2 1 0 x x x x x x
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Register ADMUX
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Register ADCSRA
                                  1   0          0   0   0   1   1   1




                                          f_ADC = f_Osc / Div_Factor
                                                = 16 MHz / 128 = 125kHz
Peter Frauscher, Version 1.3               ADC                           Seite 7
Register ADCL und ADCH
                               Conversion result




Peter Frauscher, Version 1.3              ADC      Seite 8
Register SFIOR
                                 0   0         0   0




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Peter adc atmega32 v1.3

  • 1. ADC ATMEGA32 Informationen aus: Datenblatt ATMEGA32 Ab Seite 201
  • 3. Eigenschaften Datenblatt ATMEGA32 • 10-bit Resolution • Successive approximation ADC • ±2 LSB Absolute Accuracy • 13 μs - 260 μs Conversion Time • Up to 15 kSPS at Maximum Resolution • 8 Multiplexed Single Ended Input Channels • 2 Differential Input Channels with Optional Gain of 10x and 200x • 0 - VCC ADC Input Voltage Range • Free Running or Single Conversion Mode • ADC Start Conversion by Auto Triggering on Interrupt Sources • Interrupt on ADC Conversion Complete Peter Frauscher, Version 1.3 ADC Seite 3
  • 4. Block- schalt- bild Peter Frauscher, Version 1.3 ADC Seite 4
  • 5. Register ADMUX 0 1 0 ADLAR ADCH ADCL 0 x x x x x x 9 8 7 6 5 4 3 2 1 0 1 9 8 7 6 5 4 3 2 1 0 x x x x x x Peter Frauscher, Version 1.3 ADC Seite 5
  • 6. Register ADMUX 0 1 0 0 0 0 0 1 Peter Frauscher, Version 1.3 ADC Seite 6
  • 7. Register ADCSRA 1 0 0 0 0 1 1 1 f_ADC = f_Osc / Div_Factor = 16 MHz / 128 = 125kHz Peter Frauscher, Version 1.3 ADC Seite 7
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